IS61LPS204832B用于通信和網(wǎng)絡(luò)的高性能
SRAM內(nèi)存,先進(jìn)的CMOS技術(shù)，器件集成了一個(gè)2位突發(fā)計(jì)數(shù)器，高速SRAM內(nèi)核和highdrive,能力輸出到單個(gè)單片電路,同步輸入通過(guò)寄存器控制,一個(gè)正邊沿觸發(fā)的單時(shí)鐘輸入。
特征
•內(nèi)部自定時(shí)寫(xiě)周期
•單字節(jié)寫(xiě)入控制和全局寫(xiě)入
•時(shí)鐘控制，注冊(cè)地址，數(shù)據(jù)和
控制
•使用MODE輸入進(jìn)行突發(fā)序列控制
•三芯片使能選項(xiàng)，可實(shí)現(xiàn)簡(jiǎn)單的深度擴(kuò)展
并處理流水線
•通用數(shù)據(jù)輸入和數(shù)據(jù)輸出
•取消選擇時(shí)自動(dòng)關(guān)機(jī)
•單周期取消選擇
•休眠模式，用于低功耗待機(jī)
•用于PBGA封裝的JTAG邊界掃描
• 電源
LPS：Vdd 3.3V（+ 5％），Vddq 3.3V / 2.5V（+ 5％）
VPS：Vdd 2.5V（+ 5％），Vddq 2.5V（+ 5％）
VVPS：Vdd 1.8V（+ 5％），Vddq 1.8V（+ 5％）
•JEDEC 100引腳TQFP，119球PBGA和
165球PBGA封裝
•無(wú)鉛可用
關(guān)鍵詞：SRAM
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